 由于系统正常工作时需要一个庞大的逻辑控制电路来完成两次采样过程，所以我们采用PLD来实现硬件控制逻辑。 2.2 系统的设计 在所有PLD中，由于GAL器件具有低功耗、高速度、可重复编程和输出可重组态的特点，加上它的性价比明显优于SSI/MSI器件，所以被选用来完成高准确度A/D转换器的硬件逻辑控制电路。 2.2.1 硬件逻辑控制电路 GAL16V8芯片主要有五种输出配置功能。设计中采用了其寄存器型器件中的组合输出结构和寄存器型输出结构。我们采用的GAL16V8芯片如图2所示。 它的各个管脚定义如下：  mT1：定时积分的定时时间信号(低电平有效)，Th：反馈定时信号(低电平有效)，ST：ADC转换启动信号(正跳沿有效)，Sc：二次采样信号(高电平有效)，INPUT：检零信号输入(Ux>0时为0，Ux<0时为1)，Tx：结果计数输出(高电平有效)，Sg：极性输出(Ux>0时为0，Ux<0时为1)，INT1：中断信号(正跳沿有效)，Kc：放电回路控制(高电平有效)，Kx：被测量接入控制(高电平有效)，VrN：负基准接入控制(高电平有效)，Vr：正基准接入控制(高电平有效)，Vr-10：十分之一正基准(高电平有效)，Csg：释放极性输出寄存器(高电平有效)，CLK：时钟输入端。 2.2.2 硬件逻辑控制电路工作过程 硬件逻辑电路工作时，A/D转换启动信号ST由“0”变“1”，标志第一次采样正式开始。同时，Kx变为高电平，表示接入被测量Ux;mT1变为低电平，系统进入第一次采样的定时积分时间。假设Ux>0，则检零信号INPUT为“0”。当mT1变为高电平时，第一次采样的定时积分时间结束。接入VrN，进入第一次采样的定量积分阶段。当检零信号发生变化时，表明定量积分结束。在定量积分过程中，Tx有计数结果输出，这是被测信号的高位值。中断信号INT1由“1”变“0”，表示第一次采样结束，系统进入休止阶段。当ST和二次采样信号Sc同时产生正跳沿时，系统进入第二次采样阶段。在第二次采样过程中，逻辑控制过程与第一次采样大致相同，只是定时积分时间变为第一次采样定时积分时间的m倍，即mT1，而且在每一个T1时间内，都接通反馈定时信号Th。在定值积分阶段，改用小基准电压Vr-10来进行放电。从而Tx有计数结果输出，这是被测信号的低位值。至此，两次采样A/D转换结束。
高压 IC 可取代汽车浪涌抑制器件 背景信息
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